// -p merge-assign

import "primitives/std.lib";

component main() -> () {
  cells {
    r = std_reg(4);
    add = std_add(32);
  }

  wires {
    add.left = r.out == 4'd0 ? 32'd32;
    add.left = r.out == 4'd1 ? 32'd32;
    add.left = r.out == 4'd3 ? 32'd32;
    add.left = r.out == 4'd5 ? 32'd4;
    add.left = r.out == 4'd6 ? 32'd4;

    add.right = 32'd4;
  }

  control {}
}