// Verilated -*- C++ -*- // DESCRIPTION: Verilator output: Design internal header // See Vdut.h for the primary calling header #ifndef _Vdut_VexRiscv_H_ #define _Vdut_VexRiscv_H_ #include "verilated_heavy.h" #include "Vdut__Dpi.h" class Vdut__Syms; class VerilatedVcd; //---------- VL_MODULE(Vdut_VexRiscv) { public: // PORTS VL_IN8(__PVT__clk,0,0); VL_IN8(__PVT__timerInterrupt,0,0); VL_IN8(__PVT__softwareInterrupt,0,0); VL_OUT8(__PVT__iBusWishbone_CYC,0,0); VL_OUT8(__PVT__iBusWishbone_STB,0,0); VL_IN8(__PVT__iBusWishbone_ACK,0,0); VL_OUT8(__PVT__iBusWishbone_WE,0,0); VL_OUT8(__PVT__iBusWishbone_SEL,3,0); VL_IN8(__PVT__iBusWishbone_ERR,0,0); VL_OUT8(__PVT__iBusWishbone_BTE,1,0); VL_OUT8(__PVT__iBusWishbone_CTI,2,0); VL_OUT8(__PVT__dBusWishbone_CYC,0,0); VL_OUT8(__PVT__dBusWishbone_STB,0,0); VL_IN8(__PVT__dBusWishbone_ACK,0,0); VL_OUT8(__PVT__dBusWishbone_WE,0,0); VL_OUT8(__PVT__dBusWishbone_SEL,3,0); VL_IN8(__PVT__dBusWishbone_ERR,0,0); VL_OUT8(__PVT__dBusWishbone_BTE,1,0); VL_OUT8(__PVT__dBusWishbone_CTI,2,0); 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// Symbol table public: // PARAMETERS // CONSTRUCTORS private: Vdut_VexRiscv& operator= (const Vdut_VexRiscv&); ///< Copying not allowed Vdut_VexRiscv(const Vdut_VexRiscv&); ///< Copying not allowed public: Vdut_VexRiscv(const char* name="TOP"); ~Vdut_VexRiscv(); void trace (VerilatedVcdC* tfp, int levels, int options=0); // API METHODS // INTERNAL METHODS void __Vconfigure(Vdut__Syms* symsp, bool first); private: void _ctor_var_reset(); public: static void _initial__TOP__dut__VexRiscv__1(Vdut__Syms* __restrict vlSymsp); static void _sequent__TOP__dut__VexRiscv__3(Vdut__Syms* __restrict vlSymsp); static void _sequent__TOP__dut__VexRiscv__4(Vdut__Syms* __restrict vlSymsp); static void _settle__TOP__dut__VexRiscv__2(Vdut__Syms* __restrict vlSymsp); static void traceInit (VerilatedVcd* vcdp, void* userthis, uint32_t code); static void traceFull (VerilatedVcd* vcdp, void* userthis, uint32_t code); static void traceChg (VerilatedVcd* vcdp, void* userthis, uint32_t code); } VL_ATTR_ALIGNED(128); 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