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Makefile                                           24-Jul-2006 01:21                 450
axi_lite_slave.sv                                  24-Jul-2006 01:21                2496
axi_lite_slave_tb.sv                               24-Jul-2006 01:21                3016
basic.sv                                           24-Jul-2006 01:21                 384
comb.sv                                            24-Jul-2006 01:21                 306
comb_tb.sv                                         24-Jul-2006 01:21                1281
dff.sv                                             24-Jul-2006 01:21                 320
dff_tb.sv                                          24-Jul-2006 01:21                 801
fifo.sv                                            24-Jul-2006 01:21                  99
fsm.sv                                             24-Jul-2006 01:21                 507
fsm_tb.sv                                          24-Jul-2006 01:21                 801
pico_slave.sv                                      24-Jul-2006 01:21                1102
uart.sv                                            24-Jul-2006 01:21                2299